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高速収集・処理ボード

SYHS-8R8T-2G広帯域RF送受信ボード

SYHS-8R8T-2Gは、ZU47DR RFSoCを採用し、受信8/送信8チャネル、各チャネル最大2 GHzの瞬時帯域幅を備えた広帯域RF送受信ボードです。高速RF-ADC/RF-DAC、UltraScale+ FPGAロジック、ARMプロセッサを統合し、広帯域収集、リアルタイム任意波形生成、オンチップDSPを実現します。光インターフェースによる高速・低遅延の双方向転送、外部基準クロック・トリガ同期、複数ボードのカスケード接続に対応します。

  • RFコンバータ、FPGAロジック、マルチコアARMを統合した単一RFSoC
  • 受信8/送信8チャネル、各チャネル2GHz瞬時帯域幅、広帯域収集・任意波形生成
  • 広帯域・高耐電磁干渉の高速光データ転送
  • 外部基準クロック・トリガ、複数ボードのカスケード同期
  • FPGA上のDDC/DUC・フィルタ処理でホスト負荷を低減

技術データ

技術仕様

仕様は製品カタログに基づきます。構成と動作条件については技術担当者にお問い合わせください。

SYHS-8R8T-2G 技術仕様
項目仕様/代表値
A/Dコンバータ(ADC)
チャネル数8 チャネル
ADCサンプリングレート5Gsps(最大)
ADC分解能14bit
ADC有効分解能10bit
入力電力≤1dBm (代表値)
SFDR≥60dBc
代表瞬時帯域幅2GHz
チャネル位相整合性≤5°
D/Aコンバータ(DAC)
チャネル数8 チャネル
DACサンプリングレート9.85Gsps(最大)
DAC分解能14bit
出力電力≤5dBm
代表瞬時帯域幅2GHz
FPGA・メモリ
ロジックリソース930K
CLB LUT数425K
DSPスライス数4272
インターフェースQSFP x2; SFP x1; イーサネット x1; USB3.0 x1; GPIO 28 (LVTTL)
PSDDR4GB
PLLDDR2GB
一般仕様
電源DC 12V@3A

仕様は予告なく変更される場合があります。詳細な条件、インターフェース定義、ご注文については技術担当者にお問い合わせください。

システム構成

製品ブロック図

SYHS-8R8T-2G ブロック図 1
SYHS-8R8T-2G / 図 1 画像を拡大 ↗

取扱上の注意

  • 静電気対策を行い、使用前に機器のポートが清潔であることを確認してください。
  • 該当する接続ナットは、トルクレンチで締め付けてください。
  • 校正器の損傷を防ぐため、校正前にコネクタのピン深さを確認してください。

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